Sylabus SCC0402

Syllabus

SCC0402 Arquitectura de computadoras

MTE. JOSE RAMON CAB CHAN

rcab@itescam.edu.mx

Semestre	Horas Teoría	Horas Práctica	Créditos	Clasificación
5	4	2	10

Prerrequisitos

1.- Conocer los conceptos básicos de transferencia de registros.

2.- Tener algunos conceptos básicos de las principales de una computadora personal

3.- Conocimientos vagos de eléctrónica y circuitos eléctricos

Competencias

Atributos de Ingeniería

Normatividad

1.- Acreditar el 100 de las unidades del curso semestral. 2.- Cumplir con todos los trabajos marcados en clases y extraclases. 3.- Participar en el salón de cuando se le requiera. 4.- Tener el mínimo de assitencias requerido por la subdirección académica . 5.- El alumno debe participar al menos una vez en el transcurso de la unidad

Materiales

No se requieren materiales adicionales a los especificados en la programación de clases

Bibliografía disponible en el Itescam
Título	Autor	Editorial	Edición/Año	Ejemplares

Parámetros de Examen
PARCIAL 1	Unidad I, II (Subtemas 2.1.5 Tipos de buses del Sistema)
PARCIAL 2	Unidad II (Subtemas 2.2.1 Direccionamiento en modo real),III

Contenido (Unidad / Competencia / Actividad / Material de Aprendizaje)
1. Modelos de arquitecturas de cómputo 1.1. Modelos de arquitectura de computadoras actuales 1.1.1. Modelos de arquitecturas de computadoras clàsicos Padilla Carvajal, Wilson, MODELOS DE ARQUITECTURAS DE CÓMPUTO CLÁSICAS, , Enero 2006. (23040 bytes) Introducciòn a las arquitecturas de computadoras (565248 bytes) Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001.pp 8-10 M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a ed, Ed. Prentice Hall, España 2001.pp 2-4 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003, pp 3-4 http://www.mailxmail.com/curso/informatica/arquitecturaordenadores/capitulo2.htm 1.1.2. Modelos de arquitecturas de computadoras segmentados Padilla Carvajal, Wilson, ARQUITECTURA DE COMPUTO SEGMENTADA , Enero 2006. (766464 bytes) Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001.pp 11-12 M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001.pp 8-9 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003, pp 5-8 http://www.tlm.unavarra.es/asignaturas/ac/0506/material/AC.Tema2.pdf 1.1.3. Modelos de arquitecturas de computadoras de multiprocesamiento Padilla Carvajal, Wilson, MODELOS DE ARQUITECTURA DE COMPUTO DE MULTIPROCESAMIENTO , Enero 2006. (40960 bytes) Arquitectura paralela (126464 bytes) Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001.pp 13-16 M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001.pp 10-11 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003, pp 9 -11 http://www.tlm.unavarra.es/asignaturas/ac/0506/material/AC.Tema2.pdf 1.2. Análisis de los componentes 1.2.1. Arquitectura de los CPU`s Padilla Carvajal, Wilson, ARQUITECTURAS DEL CPU , Enero 2006. (62976 bytes) Josè R Cab, Organizaciòn de la CPU ( bytes) Josè R Cab, Orquitectura de la CPU (40448 bytes) Josè R Cab, arquitectura RISC y CISC (92160 bytes) Josè R Cab, diseño de un micro (78336 bytes) Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001.pp 12-16 M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001.pp 12-15 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003, pp 6-8 http://www.mailxmail.com/curso/informatica/arquitecturaordenadores/capitulo2.htm 1.2.2. Tipos de los CPU`s Padilla Carvajal, Wilson, TIPOS DE CPU, Enero 2006. (20992 bytes) Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001.pp 17-18 M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001.pp 12-17 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003, pp 17-19 http://www.mailxmail.com/curso/informatica/arquitecturaordenadores/capitulo2.htm http://72.14.253.104/search?q=cache:XhGFSM8UoM4J:cpys.iespana.es/hardware/4.pdf+Modelos+de+arquitecturas+de+computadoras+cl%C3%A0sicos&hl=es&ct=clnk&cd=10&gl=mx&lr=lang_es 1.2.3. Características de los CPU`s Padilla Carvajal, Wilson. CARACTERÍSTICAS DEL CPU, Enero 2006. (19968 bytes) Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001.pp 23-26 M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001.pp 28-30 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. p 23-24 http://www.mailxmail.com/curso/informatica/arquitecturaordenadores/capitulo2.htm 1.2.4. Funcionamiento de los CPU`s Padilla Carvajal, Wilson, FUNCIONAMIENTO DE LOS CPU, Enero 2006. (20992 bytes) Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001.pp 35-39 M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001.pp 35-36 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003, pp 21-22 http://www.mailxmail.com/curso/informatica/arquitecturaordenadores/capitulo2.htm 1.2.5. Arquitectura de la memoria Padilla Carvajal, Wilson, ARQUITECTURA DE LA MEMORIA, Enero 2006. (36864 bytes) Josè R Cab, Organizaciòn de la memoria ( bytes) Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001.pp 34-39 M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001.pp 67-68 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003, pp 17-19 www.mailxmail.comcursoinformaticaarquitecturaordenadorescapitulo3.htm 1.2.6. Tipos de memoria Padilla Carvajal,Wilson, TIPOS DE MEMORIA, Enero 2006. (26112 bytes) Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001.pp 35-39 M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001.pp 34-39 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003, pp 24-26 www.mailxmail.comcursoinformaticaarquitecturaordenadorescapitulo3.htm http://www.monografias.com/trabajos16/memorias/memorias.shtml 1.2.7. Caracterísitcas de la memoria Padilla Carvajal, Wilson, CARACTERISTICAS DE LA MEMORIA, Enero 2006. (27648 bytes) Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001.pp 45-46 M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001.pp 32-36 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003.pp56-58 www.mailxmail.comcursoinformaticaarquitecturaordenadorescapitulo3.htm 1.2.8. Funcionamiento de las memorias Padilla Carvajal, Wilson, FUNCIONAMIENTO DE LA MEMORIA, Enero 2006. (24576 bytes) Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001.pp 48-59 M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001.pp 45-49 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003, pp 45-49 www.mailxmail.comcursoinformaticaarquitecturaordenadorescapitulo3.htm 1.2.9. Arquitectura de los dispositivos de entrada y salida Padilla Carvajal, Wilson, ARQUITECTURA DE LOS DISPOSITIVOS DE ENTRADA Y SALIDA, Enero 2006. (20992 bytes) Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001.pp 60-70 M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001.pp 70-75 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003, pp 65-70 www.monografias.com rabajos28operaciones-busoperaciones-bus.html www.mailxmail.comcursoinformaticaarquitecturaordenadorescapitulo18.htm 1.2.10. Tipos de dispositivos de entrada y salida Padilla Carvajal, TIPOS DE DISPOSITIVOS DE ENRADA Y SALIDA, Enero 2006. (33792 bytes) Josè R. Cab, Tipos de dispositivos de E/S (33792 bytes) Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001.pp 75-80 M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001.pp 66-70 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003, pp 55-58 www.monografias.com rabajos28operaciones-busoperaciones-bus.html www.mailxmail.comcursoinformaticaarquitecturaordenadorescapitulo3.htm http://www.monografias.com/trabajos33/dispositivos/dispositivos.shtml 1.2.11. Caracterísitcas de los dispositivos de entrada y salida Padilla Carvajal,Wilson, CARACTERISTICAS DE LOS DISPOSITIVOS DE ENTRADA Y SALIDA, Enero 2006. (21504 bytes) Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001.pp 85-90 M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001.pp 65-78 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. p 65-67 www.monografias.com rabajos28operaciones-busoperaciones-bus.html www.mailxmail.comcursoinformaticaarquitecturaordenadorescapitulo3.htm http://bioinfo.uib.es/~joemiro/teach/infAl/ciclo5/Garau.PDF 1.2.12. Funcionamiento de los dispositivos de entrada y salida Padilla Carvajal, Wilson, FUNCIONAMIENTO DE LOS DISPOSITIVOS DE ENTRADA Y SALIDA, Enero 2006. (21504 bytes) Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001.pp 110-112 M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001.pp 34-39 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. p 65-67 www.monografias.com rabajos28operaciones-busoperaciones-bus.html www.mailxmail.comcursoinformaticaarquitecturaordenadorescapitulo3.htm
2. Comunicación interna en la computadora 2.1. Buses 2.1.1. Bus Local Padilla Carvajal, Wilson, BUS LOCAL , Enero 2006. ( bytes) Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001.pp 113-114 M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001.pp 100-120 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. p 120-123 Padilla Carvajal, Wilson, BUS LOCAL , Enero 2006. (55552 bytes) www.monografias.com rabajos28operaciones-busoperaciones-bus.html www.mailxmail.comcursoinformaticaarquitecturaordenadorescapitulo7.htm 2.1.2. Bus de Datos Padilla Carvajal,Wilson, BUS DE DATOS, Enero 2006. (22528 bytes) Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001.pp 121-122 M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001. Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. p 120-123 www.monografias.com rabajos28operaciones-busoperaciones-bus.html www.mailxmail.comcursoinformaticaarquitecturaordenadorescapitulo7.htm http://es.wikipedia.org/wiki/Bus_de_datos 2.1.3. Bus de direcciones Padilla Carvajal, Wilson, BUS DE DIRECCIONES, Enero 2006. (22528 bytes) Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001.pp 110-112 M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001.pp 12-15 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. p 120-123 www.monografias.com rabajos28operaciones-busoperaciones-bus.html www.mailxmail.comcursoinformaticaarquitecturaordenadorescapitulo7.htm http://es.wikipedia.org/wiki/Bus_de_direcci%C3%B3n 2.1.4. Bus de Control Padilla Carvajal, Wilson, BUS DE CONTROL , Enero 2006. (20992 bytes) Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001.pp 123-125 M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001.pp 100-120 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003.pp56-58 www.monografias.com rabajos28operaciones-busoperaciones-bus.html www.mailxmail.comcursoinformaticaarquitecturaordenadorescapitulo7.htm 2.1.5. Tipos de buses Padilla Carvajal, Wilson, TIPOS DE BUSES , Enero 2006. (38912 bytes) Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001.pp 110-112 M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001.pp 121-124 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. p 1224-127 www.monografias.com rabajos28operaciones-busoperaciones-bus.html www.mailxmail.comcursoinformaticaarquitecturaordenadores.htm 2.2. Direccionamiento 2.2.1. Direccionamiento en modo real Padilla Carvajal,Wilson, DIRECCIONAMIENTO EN MODO REAL, Enero 2006. (24576 bytes) Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001.pp 110-112 M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001.pp 10-11 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. p 120-123 www.mailxmail.comcursoinformaticaarquitecturaordenadorescapitulo20.htm 2.2.2. Direccionamiento en modo protegido Padilla Carvajal, Wilson, DIRECIONAMIENTO EN MODO PROTEGIDO, Enero 2006. (24576 bytes) Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001.pp 130-135 M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001.pp 127-136 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. p 120-123 www.mailxmail.comcursoinformaticaarquitecturaordenadorescapitulo23.htm 2.2.3. Direccionamiento en modo real virtual Padilla Carvajal, Wilson, DIRECCIONAMIENTO EN MODO REAL VIRTUAL, Enero 2006. (28160 bytes) Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001.pp 11-12 M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001.pp 10-11 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003.pp56-58 www.mailxmail.comcursoinformaticaarquitecturaordenadorescapitulo23.htm 2.3. Temporización 2.3.1. Características del Reloj del sistema Padilla Carvajal, Wilson, RELOJ DEL SISTEMA , Enero 2006. (26112 bytes) Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001.pp 11-12 M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001.pp 100-120 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. p 120-123 http://www.monografias.com/trabajos17/arquitectura-computadoras/arquitectura-computadoras.shtml#reloj 2.3.2. Uso del reset del sistema M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001. Págs. 144 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. Págs. 272-275, 628-629, 676-678 Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001. Págs. 55-75 http://www.intel.com/espanol/update/contents/dt01041.htm 2.3.3. Utilización de los estados del sistema M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001. Págs. 144 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. Págs. 272-275, 628-629, 676-678 Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001. Págs. 55-75 http://www.intel.com/espanol/update/contents/dt01041.htm 2.4. Interrupciones de Hardware 2.4.1. Interrupciones de HW enmascarable Padilla Carvajal, Wilson, INTERRUPCIONES DE HARDWARE NO- ENMASCARABLES , Enero 2006. (56320 bytes) Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. Págs. 642-643. M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001. Págs. 217-297 Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001. Págs. 56-64 Blázquez Soriano, José Miguel, INTERRUPCIONES EN LA ARQUITECTURA INTEL, Diciembre de 2004. (281795 bytes) Lavara Cana, Jesús y Gil González, Alberto, ENTRADA/SALIDA, ARRANQUE E INTERRUPCIONES, Enero 2003 (167231 bytes) http://www.mailxmail.com/curso/informatica/arquitecturaordenadores/capitulo2.htm 2.4.2. Interrupciones de HW no enmascarable Padilla Carvajal, Wilson, INTERRUPCIONES DE HARDWARE NO- ENMASCARABLES , Enero 2006. (30208 bytes) Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. Págs. 642-643. M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001. Págs. 217-297 Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001. Págs. 56-64 Blázquez Soriano, José Miguel, INTERRUPCIONES EN LA ARQUITECTURA INTEL, Diciembre de 2004. (281795 bytes) Lavara Cana, Jesús y Gil González, Alberto, ENTRADA/SALIDA, ARRANQUE E INTERRUPCIONES, Enero 2003 (167231 bytes) http://www.mailxmail.com/curso/informatica/arquitecturaordenadores/capitulo2.htm 2.5. Acceso directo a memoria 2.5.1. Utilización del sistema de video Padilla Carvajal, Wilson, ACCESO DIRECTO A MEMORIA EN SISTEMAS DE VIDEO , Enero 2006. (27648 bytes) M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001. Págs. 445-450 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. Págs. 274-275, 293, 579, 628-629 Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001. Págs. 63, 201-203, 202f-203f http://es.wikipedia.org/wiki/DMA 2.5.2. Utilización del sistema de discos Padilla Carvajal, Wilson, ACCESO DIRECTO A MEMORIA EN SISTEMAS DE DISCOS , Enero 2006. (83456 bytes) M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001. Págs. 445-450 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. Págs. 274-275, 293, 579, 628-629 Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001. Págs. 63, 201-203, 202f-203f http://html.rincondelvago.com/bus-de-direcciones_dispositivo-dma.html 2.5.3. Utilización de otras aplicaciones Padilla Carvajal, Wilson, ACCESO DIRECTO A MEMORIA EN OTRAS APLICACIONES , Enero 2006. (35328 bytes) M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001. Págs. 445-450 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. Págs. 274-275, 293, 579, 628-629 Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001. Págs. 63, 201-203, 202f-203f http://html.rincondelvago.com/bus-de-direcciones_dispositivo-dma.html
3. Selección de componentes para ensamble de equipos de cómputo 3.1. Componentes para ensamble equipos de cómputo 3.1.1. Chipset Padilla Carvajal, Wilson, CHIPSET , Enero 2006. (115712 bytes) M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001. Págs. 21-22 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. Págs. 123-145 Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001. Págs. 56 http://www.conozcasuhardware.com/quees/chipset.htm 3.1.2. Controlador del Bus Padilla Carvajal, Wilson, Controlador del Bus , Enero 2006. (51200 bytes) M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001. Págs. 550 Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001. Págs. 71-72 www.monografias.com rabajos28operaciones-busoperaciones-bus.html www.mailxmail.comcursoinformaticaarquitecturaordenadorescapitulo3.htm 3.1.3. Puerto de entrada y salida Padilla Carvajal, Wilson, Puertos de entrada y salida , Enero 2006. (98816 bytes) M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001. Págs. 416 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. Págs. 98-101, 546 http://www.zator.com/Hardware/H2_5.htm 3.1.4. Conceptos generales y características del CPU Padilla Carvajal, Wilson, Unidad Central de Procesos , Enero 2006. (23040 bytes) Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001. Págs. 8, 65 http://www.ii.uam.es/~fjgomez/innovacion_docente/cpu/CPU1.html 3.1.5. Controlador de DMA Padilla Carvajal, Wilson, CONTTROLADOR DE DMA , Enero 2006. (32256 bytes) M. Morris Mano. ARQUITECTURA DE COMPUTADORAS. 6a, Ed. Prentice Hall, España 2001. Págs. 445-450 Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. Págs. 274-275, 293, 579, 628-629 Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001. Págs. 63, 201-203, 202f-203f http://es.wikipedia.org/wiki/DMA 3.1.6. Circuitos de temporización y control Padilla Carvajal, Wilson, CIRCUITOS DE TEMPORIZACIÓN Y CONTROL , Enero 2006. (122880 bytes) Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. Págs. 272-273, 628-629, 676-678,390-402,575,588-595 http://www.hispavila.com/3ds/lecciones/lecc7.htm http://www.hispavila.com/3ds/lecciones/lecc7.htm 3.1.7. Controladores de video Padilla Carvajal, Wilson, CONTROLADORES DE VIDEO , Enero 2006. (53760 bytes) Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. 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Apliacaciones de entrada y salida Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. Págs. 272-273 Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001. Págs. 567-578 http://www.videa.com.ar/software.php http://www.hispavila.com/3ds/lecciones/lecc7.htm http://www.monografias.com/trabajos7/mopla/mopla.shtml 3.2.2. Apliacaciones de almacenamiento del Chip Set Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. Págs. 272-273 Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001. Págs. 567-578 http://www.videa.com.ar/software.php http://www.hispavila.com/3ds/lecciones/lecc7.htm http://www.monografias.com/trabajos7/mopla/mopla.shtml 3.2.3. Fuentes de alimentación del Chip Set Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. Págs. 272-273 Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001. Págs. 567-578 http://www.videa.com.ar/software.php http://www.hispavila.com/3ds/lecciones/lecc7.htm http://www.monografias.com/trabajos7/mopla/mopla.shtml 3.3. Ambientes de servicio de los componentes 3.3.1. Servicios de los componentes en los negocios Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. Págs. 272-273 Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001. Págs. 567-578 http://www.videa.com.ar/software.php http://www.hispavila.com/3ds/lecciones/lecc7.htm http://www.monografias.com/trabajos7/mopla/mopla.shtml 3.3.2. Servicios de los componentes en la industria Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. Págs. 272-273 Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001. Págs. 567-578 http://www.videa.com.ar/software.php http://www.hispavila.com/3ds/lecciones/lecc7.htm http://www.monografias.com/trabajos7/mopla/mopla.shtml 3.3.3. Servicios de los componentes en el comercio electronico Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. Págs. 272-273 Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001. Págs. 567-578 http://www.videa.com.ar/software.php http://www.hispavila.com/3ds/lecciones/lecc7.htm http://www.monografias.com/trabajos7/mopla/mopla.shtml
4. Microcontroladores 4.1. Arquitectura de los microcontroladores 4.1.1. Terminales de los microcontroladores Padilla Carvajal, Wilson, TERMINALES DE LOS MICROCONTROLADORES, Enero 2006. (28672 bytes) Brey Barry B, MICROPROCESADORES INTEL: ARQUITECTURA, PROGRAMACIÓN E INTERFASE, 4a. Ed. , Editorial Prentice Hall, Mexico 2003. Págs. 272-273 Stallings, William, ORGANIZACIÓN Y ARQUITECTURA DE COMPUTADORAS, Ed. Pearson Education. España 2001. Págs. 567-578 M. Morris Mano, LOGICA DIGITAL Y DISEÑO DE COMPUTADORAS, 1ª edición, Ed. Prentice Hall, México 2003, Pags 234-267. M. Morris Mano, ARQUITECTURA DE COMPUTADORAS , 4ª edición, Ed. Prentice Hall, México 2003, Pags 221-245. Padilla Carvajal, Wilson, TERMINALES EN LOS MICROCONTROLADORES, Enero 2006. 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